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Si1141/42/43
4.2. Command Protocol
The I 2 C map implements a bidirectional message box between the host and the Si1141/42/43 Sequencer. Host-
writable I 2 C registers facilitate host-to-Si1141/42/43 communication, while read-only I 2 C registers are used for
Si1141/42/43-to-host communication.
Unlike the other host-writable I 2 C registers, the COMMAND register causes the internal sequencer to wake up from
Standby mode to process the host request.
When a command is executed, the RESPONSE register is updated. Typically, when there is no error, the upper
four bits are zeroes. To allow command tracking, the lower four bits implement a 4-bit circular counter. In general, if
the upper nibble of the RESPONSE register is non-zero, this indicates an error or the need for special processing.
The PARAM_WR and PARAM_RD registers are additional mailbox registers.
In addition to the registers in the I 2 C map, there are environmental parameters accessible through the Command/
Response interface. These parameters are stored in the internal ram space. These parameters generally take
more I 2 C accesses to read and write. The Parameter RAM is described in "4.6. Parameter RAM" on page 52.
Table 5. Command Register Summary
COMMAND Register
Name Encoding
PARAM_QUE 100 aaaaa
PARAM_W
R Register
—
PARAM_RD
Register
nnnn nnnn
Error Code in
RESPONSE Register
?
Description
Reads the parameter pointed to by
RY
bitfield [4:0] and writes value to
PARAM_RD.
See Table 10 for parameters.
PARAM_SET
101 aaaaa
dddd
nnnn nnnn
?
Sets parameter pointed by bitfield
dddd
[4:0] with value in PARAM_WR, and
writes value out to PARAM_RD. See
Table 10 for parameters.
PARAM_AND
110 aaaaa
dddd
nnnn nnnn
?
Performs a bit-wise AND between
dddd
PARAM_WR and Parameter pointed
by bitfield [4:0], writes updated value
to PARAM_RD.
See Table 10 for parameters.
PARAM_OR
111 aaaaa
dddd
nnnn nnnn
?
Performs a bit-wise OR of
dddd
PARAM_WR and parameter pointed
by bitfield [4:0], writes updated value
to PARAM_RD. See Table 10 for
parameters.
NOP
000 00000
—
—
?
Forces a zero into the RESPONSE
register
RESET
000 00001
—
—
?
Performs a software reset of the
firmware
BUSADDR
Reserved
Reserved
PS_FORCE
000 00010
000 00011
000 00100
000 00101
—
—
—
—
—
—
—
—
—
—
—
?
Modifies I 2 C address
—
—
Forces a single PS measurement
20
Rev. 1.3
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